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标准详细信息 |
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标准状态 | 现行 |
标准编号 | T/EDASQUARE 013—2024 |
中文标题 | 数字集成电路逻辑综合工具测试标准 |
英文标题 | Testing Standard of Logic Synthesis Tools for Digital Integrated Circuits |
国际标准分类号 | 31.200 |
中国标准分类号 | |
国民经济分类 | I6520 集成电路设计 |
发布日期 | 2024年09月21日 |
实施日期 | 2024年12月22日 |
起草人 | 姚海龙、冀伟清、储著飞、罗国杰、赵振波、吴涛、王琦、闫福强、李菲、尹敏、杨积慧、刘洋、刘渤海、乔薛鹏、杨晓剑、顾正华、郭令仪、史峰。 |
起草单位 | 北京科技大学、宁波大学、北京大学、深圳市海思半导体有限公司、上海合见工业软件集团有限公司、浙江雷娜科技有限公司、深圳鸿芯微纳技术有限公司、上海立芯软件科技有限公司、北京华大九天科技股份有限公司、上海芯思维信息科技有限公司。 |
范围 | |
主要技术内容 | 本文件规定了电子设计自动化逻辑综合工具的测试标准,包括测试目的、测试对象、测试原理、测试环境和测试功能。 本文件适用于电子设计自动化逻辑综合工具的研发、测试、评估和验收等,也适用于电子设计自动化逻辑综合工具的质量(PPA、功能正确性)、功能完备性、性能(运行时间、内存开销)、设计规模的评价工作。 |
是否包含专利信息 | 否 |
标准文本 | 不公开 |
团体详细信息 |
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团体名称 | 上海电子设计自动化发展促进会 |
登记证号 | 51310000MJ4905543H | 发证机关 | 上海市民政局 |
业务范围 | 开展电子设计自动化及相关领域的调查研究,技术创新,编辑出版,标准制定,测试评价,培训与交流,展览展示,承接相关委托事项。(涉及行政许可的,凭许可证开展业务) |
法定代表人/负责人 | 郑云升 |
依托单位名称 | |
通讯地址 | 上海市浦东新区龙东大道3000号1幢裙房217-08室 | 邮编 : 201203 |
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